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40 nm Device Portfolio
Arria II GZ FPGA Features
Maximum Resource Count for Arria II GZ FPGAs (0.9 V)
EP2AGZ225
EP2AGZ300
EP2AGZ350
ALMs
LEs (K)
Registers
M9K memory blocks
M144K memory blocks
MLAB memory (Kb)
Embedded memory (Kb)
18 x 18 multipliers
Global clock networks
Regional clock networks
Periphery clock networks
PLLs
Design security
I/O voltage levels
supported (V)
89,600
224
179,200
1,235
0
2,850
11,115
800
64
8
119,200
298
238,400
1,248
24
4,420
14,688
920
16
88
88
8
3
1.2, 1.5, 1.8, 2.5, 3.0
139,400
349
278,800
1,248
36
4,420
16,416
1,040
88
8
LVTTL, LVCMOS, PCI, PCI-X, LVDS, mini-LVDS, RSDS, LVPECL, Differential SSTL-15,
I/O standards supported
Differential SSTL-18, Differential SSTL-2, Differential HSTL-12, Differential HSTL-15 (I and II),
Differential HSTL-18, SSTL-15 (I and II), SSTL-18 (I and II), 1.2 V HSTL (I and II),
SSTL-2 (I and II), 1.5 V HSTL (I and II), 1.8 V HSTL (I and II)
Emulated LVDS channels, 1,152 Mbps
LVDS channels, 1,250 Mbps
(receive/transmit)
Embedded DPA circuitry
OCT
Transceiver count (6.375 Gbps)
PCIe hard IP blocks (value as 1.1, 2.0, etc)
Memory devices supported
184
184
Up to 86
3
Series and differential
Up to 24
1
DDR3, DDR2, DDR, QDR II, RLDRAM 2, SDR
184
Altera Product Catalog
?
2013
?
www.altera.com
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